減小鎖相環的鎖定時間可以採取哪些措施

時間 2021-09-02 18:36:24

1樓:匿名使用者

pll 的反饋操作使vco 鎖定於正確的頻率。鎖定速度取決於非線性周跳行為。pll總鎖定時間包括兩個部分:

vco頻段校準時間和pll周跳時間。vco頻段校準時間僅取決於pfd頻率;pfd頻率越高,鎖定時間越短。pll 周跳時間由所實現的環路頻寬決定。

當環路頻寬比pfd 頻率窄時,小數n 分頻/整 數n 分頻頻率合成器就會發生周跳。pfd 輸入端的相位誤差積累過快,pll 來不及校正,電荷泵暫時沿錯誤方向吸入電荷,使鎖定時間急劇縮短。如果pfd 頻率與環路頻寬的比值提高,周跳也會增加;對於給定pfd 週期,提高環路頻寬會縮短周跳時間。

2樓:函綺楣

怎樣測量pll的鎖定時間? ――bjlk pll的鎖定時間是pll的一個重要引數,它決定了pll的輸出能從一個頻點快速跳變到另一個頻點的能力。鎖定時間的測量有兩種方法,一種是頻域的方法,典型的儀器是agilent的訊號源分析儀e5052,另一種是時域的方法,典型的儀器是實時示波器。

示波器的使用可能大家更熟悉一些,下面以agilent示波器為例,看一下如何進行pll鎖定時間的測量。 典型的pll電路原理如下:給定一個參考頻率fin,pll應該可以通過設定n和m的值來控制vco產生需要的輸出頻率。

當fin或n/m值有變化時,vco的輸出頻率應該能快速穩定到期望的輸出頻率,從輸入變化到vco穩定到新的頻率點的時間就是vco的鎖定時間。 為了方便測試,我們假定可以改變pll的輸入訊號頻率並可以同時觀測到輸入訊號和輸出訊號。測試組網如下。

控制訊號的輸出通過功分器分成2路,一路送正弦波訊號源控制產生頻率跳變,另一路送示波器進行觸發。正弦波訊號源在控制訊號的控制下產生頻率跳變,輸出訊號也通過功分器分成2路,一路送被測pll的輸入端,另一路送示波器。pll的輸出也送入示波器。

測試步驟: 1/ 開啟示波器的抖動測量功能,對pll輸入訊號(通道2)進行週期測量(週期的變化就反映了輸入訊號頻率的變化),得到輸入訊號週期隨時間的變化曲線(通道4)。從通道4的波形明顯可以看到pll輸入訊號頻率隨時間的變化。

測量出從控制訊號加上到pll輸入訊號改變的時間t1。這是正弦波訊號源本身鎖相環的鎖定時間。注意事項:

測試中要求正弦波訊號源本身鎖相環的鎖定時間要快於被測鎖相環的鎖定時間。如果正弦波訊號源本身鎖相環穩定時間較長的話,t1的測量會有較大誤差,造成最後測試結果不準確。 2/ 用同樣方法對pll輸出訊號(通道3)進行週期測量(週期的變化就反映了輸入訊號頻率的變化),得到輸出訊號週期隨時間的變化曲線。

測量出從控制訊號加上到pll輸出訊號改變並穩定的時間t2。是否穩定的判別標準是輸出訊號頻率是否落入期望的區間內。 3/ (t2-t1)就是被測鎖相環的鎖定時間。

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