懂電路的高手進來,上拉電阻的問題

時間 2022-02-21 13:25:03

1樓:匿名使用者

這句話是針對ttl電路說的,因為ttl電路輸出高電平是在2.4v以上,達不到cmos所需要的邏輯1的最低輸入電平(vihmin = 3.5v)這樣ttl對cmos就不能驅動。

為解決這個問題,就接一隻上拉電阻。這個上拉電阻和我們常用的有點性質不同:

我們知道,ttl是電晶體-電晶體邏輯電路,它不象cmos,ttl在輸出級的電路結構是在三極體上連線的是負載電阻(它不象cmos是一隻互補管)正因為是電阻,所以我們加一個上拉電阻r1,是相當於在這個(ttl內部的)負載電阻上並了一隻電阻,這樣ttl輸出級的負載電阻就變小了,從而使ttl的輸出電平提高了,以滿足cmos對電平的要求。以上完全可以用電晶體數位電路去理解。

附帶說一句,加了上拉電阻後,會使ttl的輸出低電平稍稍變高,這一點要注意。

問題補充:

是你看懂沒有啊,(ui如果是3.3v,加了上拉還是3.3v,很明顯的)是這樣嗎,試過了?cmos的輸入具有鉗位能力嗎?仔細地深入地去了解ttl的電路結構。

2樓:匿名使用者

呵呵,不要把自己逼到死衚衕

其實上拉電阻裡沒有電流通過,上拉後可以理解為電阻兩端等電位,你只要記住

電路形式就可以了

3樓:匿名使用者

原本ui是3.3v,如圖上拉之後當然就是5v了。上拉就是這個作用嘛

懂水晶的朋友進來下。謝謝拉

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